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C1 C2 C3 C4 C5 LRC
b1 1 0 1 0 1 1
b2 0 1 0 0 1 0
b3 1 1 1 0 0 1
[COLOR=Red]b4 0 0 1 1 0 1[/COLOR]
b5 0 0 1 1 0 0
[COLOR=Red]b6 0 1 0 0 1 1[/COLOR]
b7 1 0 0 0 1 0
VRC 1 1 0 0 0 0
Si on regarde en colonne, je ne détecte pas d'erreur sur la parité.
Donc à priori le VRC ne trouve pas d'erreur.
Mais le LRC a un soucis sur les lignes b4 et b6.
Mais du coup le soucis c'est que si on changer des bits dans ces séquences là, ça va changer le VRC qui était correct etc etc, c'est un cercle vicieux.
On peut toujours faire des hypothèses, par exemples si on met un bit 1 en b4C1 et b6C1 les deux codes sont corrects, mais on ne peut pas être sur que c'est ce qu'il fallait transmettre.